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执行WFI只说明内核准备休息；外设时钟、调试保持、唤醒事件和板外负载仍可能继续耗电MCU进入低功耗后整板电流不降，常见原因不是指令无效，而是选错模式、外设未关、挂起事件立即唤醒、调试器保持时钟，或外围器件仍由GPIO供电。要把芯片状态与整板

压接连接器的禁布不是围着焊盘画一圈。连接器本体、配合护套、插拔方向、压接治具和装配公差会共同扫过一块三维空间；任何器件进入这块空间，都可能在样机装配时卡住。PCB评审时，连接器旁边的器件已经退了1mm，DRC也没有报错，装配人员却仍说压不

天线在目标频率上匹配良好，只能说明端口反射较小。发射波与接收天线的极化方向若不一致，可接收的电场投影会下降；线极化接近正交时，链路余量可能显著缩小。两根天线都在目标频段，驻波也正常，距离不变时却只要把接收端旋转九十度，RSSI就明显下降，

SPI的SCK和MOSI可以同时送到多颗从机，但每颗从机需要独立片选。若两路CS重叠，或未选中器件没有释放MISO，两颗推挽输出可能同时驱动一条线，出现中间电平、错误位和额外电流。一颗SPI Flash单独工作正常，再并上一颗ADC后，S

寄存器分频、PLL或时钟管理资源的输出一旦驱动新的时钟脚，静态时序分析就需要知道它与源时钟的关系。只约束入口时钟，不能保证所有生成时钟的周期、相位和目标节点都被正确建模。代码里用寄存器把主时钟二分频，LED和状态机在板上都能跑，时序报告也

开关管与散热器之间存在寄生电容，快速电压变化会把位移电流耦合到散热器。散热器接到哪里、连接多长、回路经过机壳还是线缆，会决定这股高频电流被就近收住，还是被送进更大的共模天线。开关电源整改时，把金属散热器接到保护地，万用表测起来连接可靠，辐

“虚断”只说明运放输入电流足够小，可以在很多场景忽略，不代表它严格为零。输入偏置电流流过传感器和偏置网络的等效电阻，会形成输入压降，并按电路噪声增益传到输出。同一颗运放，直接短接输入时零点正常，接上高阻传感器或兆欧级偏置网络后，输出却稳定

端接是给传输线末端吸收反射，不是给每颗收发器配一个固定电阻。两线多点总线在每个节点都并联端接，会把总负载压得过低；长支路和星形分叉还会制造新的电气末端。RS‑485通信不稳，看到资料说“要端接”，于是主站和每个从站都焊上一只端接电阻。结果